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[理工] 計組 pipeline delayed branch

作者: ouskit (ouskit)   2019-11-03 17:37:59
http://i.imgur.com/c2lSyEs.jpg
請問這題解答中的 addiu 與 sw 這樣排不會有 hazard 嗎？ 還是題目沒有明講一個 clock
作者: Handsomeshen (洗澡是骯髒人的事)   2019-11-03 18:26:00
他要的就是還沒減-4的
作者: b10007034 (Warren)   2019-11-03 19:46:00
先寫後讀跟sw, addiu 沒關係吧？先寫後讀是addiu 跟bne的reg然後通常是假設MIPS的架構所以可以先寫後讀，除非題目先說沒有
作者: ouskit (ouskit)   2019-11-03 20:13:00
感謝兩位大大回覆(≧ω≦)/
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