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[理工] 計組 pipeline
作者:
shinle14
2019-11-04 22:22:28
1.
http://i.imgur.com/mJINC6r.jpg
http://i.imgur.com/BwyeTit.jpg
想問這題的PLA上面部份怎麼是這樣畫,還有卡諾圖怎麼有五個狀態,題目不是給四個嗎
2.
http://i.imgur.com/zwa9okU.jpg
這題不太懂1的選項
3.
http://i.imgur.com/3S7IHcL.jpg
這題也是不太懂1的選項
麻煩各位了
作者:
bochengchen
(LFII)
2019-11-04 22:36:00
第一題的PLA就是要檢查那四個狀態,四個狀態分別檢查之後,再用or確定有沒有任何一個是滿足的!
https://i.imgur.com/Lg01P1v.jpg
四個狀態不代表kmap裡面只能右四個1。Ex:A=0 C=1 010 001都符合條件第二題的a講說,在mem級沒辦法給出正確的data 是一種control hazard 所以false3 (1) load use發生在load 後面的instru存取reg但是load instruction還沒完成
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